Hardware :: Simulador Hardware :: Simulator es una extensión Perl para el lenguaje del descriptor de hardware Perl.
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Hardware :: Simulator es una extensión Perl para el lenguaje del descriptor de hardware Perl. Hardware :: Simulator es una extensión Perl para el lenguaje del descriptor de hardware de Perl.Synopsis Use Hardware :: Simulator; # Newsignal (perl_variable ); # Crear una señal llamada $ in_clk, dale un valor inicial de 1 newsignal (My $ in_clk, 1); # Repetidor (Time_Units, Code_ref) # Cada vez que se llame a la referencia del código, comenzando en el repetidor de la hora actual (5, sub {if ($ in_clk == 0) {$ in_clk = 1;} else {$ in_clk = 0;} }); # Responder (, Code_ref); # Responder a cualquier cambio a las señales llamando a la referencia del código. # CUALQUIER TIEMPO OUT_CLK CAMBIOS, VALOR DE imprimir el reloj y la hora de simulación. Responder ($ OUT_CLK, SUB {MY $ TIME = SIMTIME (); Imprimir "OUT_CLK = $ OUT_CLK. TIEMPO = $ TIMEN";}); # Inicie el procesamiento de eventos y programación de eventos. EventLoop (); Hardware :: Simulator ==> Un descriptor de hardware Perl LanguageHardware :: Simulator es una versión liviana de VHDL o VeriLog HDL. Todos estos idiomas se desarrollaron como medios para describir hardware.Hardware :: Simulator se creó como un medio para prototipo rápidamente un diseño básico de hardware y simularlo. VHDL y VeriLOG son ambos restrictivos a sus propios formas. Hardware :: Simulador fue creado para poner rápidamente algo juntos como una "prueba de concepto", para mostrar que un concepto de diseño funcionaría o no. Y luego el diseño podría ser traducido a VHDL o VeriLOG. El problema que comenzó todo esto estaba diseñando un FIFO para una escalada de video ASIC. El chip usó un búfer para almacenar datos de video entrantes. El ASIC lee el búfer para generar la imagen de video saliente. Estimamos lo grande que pensamos que debíamos ser el amortiguador que debía ser, pero queríamos confirmar que nuestros números estaban correctos ejecutando simulaciones. El problema era que debíamos realizar cientos de simulaciones diferentes, dadas las permutaciones de formatos de imagen de entrada, formatos de imagen de salida, y las frecuencias de reloj de entrada / salida. También teníamos archivos de texto que contienen formatos y frecuencias válidas. Un archivo de texto como entrada llamado PERL para manipular, dividir, formatear y extraer los datos correctamente. Este DATOS tuvo que traducirse en la simulación de HDL. El problema fue que no hubo una forma fácil de escribir un script Perl que simulaba el hardware, por lo que la única solución era tener PERL DRIVE un simulador de verilog y pasar todos estos parámetros a través de los parámetros de la línea de comandos. Entonces, los archivos de Verilog tuvieron que ser creados, y el simulador tuvo que ser conducido, y el resultado final fue mucho trabajo para simular una simple FIFO.time, no me permitió desarrollar un paquete HDL para PERL para resolver el problema original , pero lo tomé en mi tiempo libre. y eventualmente hardware :: Nació el simulador. Requisitos: · Perl

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